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本科及以上學(xué)歷，微電子、電子信息、通信工程及相關(guān)專業(yè)背景；熟悉VerilogHDL語言，有VerilogHDL編程經(jīng)驗(yàn)者優(yōu)先；了解FPGA基礎(chǔ)知識，熟悉FPGA開發(fā)流程，有Xilinx FPGA開發(fā)和調(diào)試經(jīng)歷者優(yōu)先；有SerDes相關(guān)高速接口開發(fā)經(jīng)驗(yàn)者優(yōu)先。

工作地點(diǎn)：天津/成都