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工作職責：

1. 負責數字集成電路的驗證規劃、測試平臺搭建及驗證工作，確保設計滿足功能、性能及覆蓋率要求；

2. 編寫驗證計劃、測試用例和驗證報告，對驗證結果進行分析和總結，確保驗證的完整性和高效性；

3. 使用SystemVerilog、UVM等高級驗證語言和方法學進行驗證環境的開發和維護；

4. 與設計團隊緊密合作，理解設計規格，識別驗證難點，提出有效的驗證策略；

5. 跟蹤并解決驗證過程中發現的問題，與設計團隊共同優化設計，提升產品質量。

任職要求：

1. 熟悉數字電路基本原理，了解集成電路設計流程；

2. 熟練掌握SystemVerilog編程語言，了解UVM驗證方法學；

3. 具有良好的團隊合作精神和溝通能力，能夠與設計、測試等其他部門有效協作；

4. 有相關項目經驗或實習經驗者優先。